Mapeamento de pequena ordem na hierarquia digital sincrona

Detalhes bibliográficos
Autor(a) principal: Machado, Luis Flavio Collares
Data de Publicação: 1996
Tipo de documento: Dissertação
Idioma: por
Título da fonte: Biblioteca Digital de Teses e Dissertações da Universidade Estadual de Campinas (UNICAMP)
Texto Completo: https://hdl.handle.net/20.500.12733/1584604
Resumo: Orientador: Rege Romeu Scarabucci
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spelling Mapeamento de pequena ordem na hierarquia digital sincronaMapeamento digitalSincronizaçãoTelecomunicaçõesOrientador: Rege Romeu ScarabucciDissertação (mestrado) - Universidade Estadual de Campinas, Faculdade de Engenharia Eletrica e de ComputaçãoResumo: A rede HDS (Hierarquia Digital Síncrona) já é uma realidade, hoje várias empresas estão implantando este sistema em todo o país. A HDS tornou-se um padrão mundial, não colocando na obsolescência as atuais redes PDH, pois estas podem ser interconectadas com as novas redes. Este novo padrão possibilita a interligação entre sistemas de 1,5 Mb/s e 2 Mb/s, não existindo mais fronteiras de incompatibilidade entre sistemas europeus e americanos. O gerenciamento mais abrangente, o uso da fibra óptica como meio de transmissão, uma estrutura mais inteligente de mapeamento de sinais e a possibilidade de cross-conexão consolidaram a HDS. Neste trabalho foram desenvolvidas três li¿n ANTPOT. H¿as de pesquisa: Um primeiro estudo desenvolve uma formulação para mapeamento e desmapeamento de canais de 64 kb/s nos containers VC-12 e VC-l1. A seguir, blocos funcionais são projetados utilizando a linguagem VHDL1para mapeamento e desmapeamento de canais de 2Mb/s. Finalmente muitas simulações são realizadas com blocos funcionais anteriormente projetados, utilizando agora VHDL a nível estrutural, visando principalmente a observação do fenômeno de escorregamento de sinal(slips)MestradoMestre em Engenharia Elétrica[s.n.]Scarabucci, Rege Romeu, 1937-Universidade Estadual de Campinas (UNICAMP). Faculdade de Engenharia Elétrica e de ComputaçãoPrograma de Pós-Graduação em Engenharia ElétricaUNIVERSIDADE ESTADUAL DE CAMPINASMachado, Luis Flavio Collares19961996-11-01T00:00:00Zinfo:eu-repo/semantics/publishedVersioninfo:eu-repo/semantics/masterThesisapplication/pdf154 f. : il.(Broch.)https://hdl.handle.net/20.500.12733/1584604MACHADO, Luis Flavio Collares. Mapeamento de pequena ordem na hierarquia digital sincrona. 1996. 154 f. Dissertação (mestrado) - Universidade Estadual de Campinas, Faculdade de Engenharia Eletrica e de Computação, Campinas, SP. Disponível em: https://hdl.handle.net/20.500.12733/1584604. Acesso em: 2 set. 2024.https://repositorio.unicamp.br/acervo/detalhe/115121porreponame:Biblioteca Digital de Teses e Dissertações da Universidade Estadual de Campinas (UNICAMP)instname:Universidade Estadual de Campinas (UNICAMP)instacron:UNICAMPinfo:eu-repo/semantics/openAccess2014-04-18T09:27:35Zoai::115121Biblioteca Digital de Teses e DissertaçõesPUBhttp://repositorio.unicamp.br/oai/tese/oai.aspsbubd@unicamp.bropendoar:2014-04-18T09:27:35Biblioteca Digital de Teses e Dissertações da Universidade Estadual de Campinas (UNICAMP) - Universidade Estadual de Campinas (UNICAMP)false
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