Programmable virtual switches : design and implementation of the forwarding engine and supporting features
Autor(a) principal: | |
---|---|
Data de Publicação: | 2020 |
Tipo de documento: | Dissertação |
Idioma: | eng |
Título da fonte: | Biblioteca Digital de Teses e Dissertações da UFRGS |
Texto Completo: | http://hdl.handle.net/10183/211315 |
Resumo: | A virtualização se tornou a potência de vários conceitos de rede, de redes locais virtuais (VLANs) a switches definidos por software, plano de controle definido por software, etc. Propostas recentes como HyPer4, HyperVDP e P4Visor levaram o conceito ao plano de encaminhamento, permitindo emulação de vários contextos de rede e/ou compondo várias funções através de um único programa. Apesar do progresso alcançado, o verdadeiro potencial da virtualização do plano de encaminhamento permanece inexplorado. Neste trabalho, apresentamos PvS, uma arquitetura reconfigurável para virtualização do plano de dados. PvS fornece execução paralela e hot swap de instâncias de switches virtuais, sem a necessidade de código-fonte do switch (para emulação ou composição de programa). Experimentou-se PvS em uma placa NetFPGA-SUME com quatro switches virtuais: um switch de camada 2, um roteador simples, um firewall e um switch de telemetria de rede(in-band telemetry). As medições de ocupação da área evidenciam a viabilidade de executar até treze switches virtuais em paralelo. Comparado aos trabalhos existentes, os dados de desempenho mostram uma melhoria de até duas ordens de magnitude para largura de banda e seis ordens para latência. |
id |
URGS_0de69bc22728368e7d909a4c3dee99b1 |
---|---|
oai_identifier_str |
oai:www.lume.ufrgs.br:10183/211315 |
network_acronym_str |
URGS |
network_name_str |
Biblioteca Digital de Teses e Dissertações da UFRGS |
repository_id_str |
1853 |
spelling |
Tirone, Mateus Saquetti Pereira de CarvalhoAzambuja, José Rodrigo Furlanetto deCordeiro, Weverton Luis da Costa2020-07-02T03:36:59Z2020http://hdl.handle.net/10183/211315001115567A virtualização se tornou a potência de vários conceitos de rede, de redes locais virtuais (VLANs) a switches definidos por software, plano de controle definido por software, etc. Propostas recentes como HyPer4, HyperVDP e P4Visor levaram o conceito ao plano de encaminhamento, permitindo emulação de vários contextos de rede e/ou compondo várias funções através de um único programa. Apesar do progresso alcançado, o verdadeiro potencial da virtualização do plano de encaminhamento permanece inexplorado. Neste trabalho, apresentamos PvS, uma arquitetura reconfigurável para virtualização do plano de dados. PvS fornece execução paralela e hot swap de instâncias de switches virtuais, sem a necessidade de código-fonte do switch (para emulação ou composição de programa). Experimentou-se PvS em uma placa NetFPGA-SUME com quatro switches virtuais: um switch de camada 2, um roteador simples, um firewall e um switch de telemetria de rede(in-band telemetry). As medições de ocupação da área evidenciam a viabilidade de executar até treze switches virtuais em paralelo. Comparado aos trabalhos existentes, os dados de desempenho mostram uma melhoria de até duas ordens de magnitude para largura de banda e seis ordens para latência.Virtualization has become the powerhouse for several networking concepts, from virtual local area networks (VLANs) to software switches, software-defined control plane, etc. Recent proposals like HyPer4, HyperVDP, and P4Visor brought the concept to the forwarding plane, by enabling emulation of several network contexts and/or composing several functions through a single program. In spite of the progress achieved, the real potential of forwarding plane virtualization remains untapped. In this work, we present PvS, a reconfigurable architecture for data plane virtualization. PvS provides parallel execution and hot-swapping of virtual switch instances, without requiring switch source code (for either emulation or program composition). We experimented PvS on a NetFPGA-SUME board with four virtual switches: a layer-2 switch, a simple router, a firewall, and an inband telemetry. Area occupation measurements evidence the feasibility of running up to eight virtual switches in parallel. Compared to existing work, performance data show an improvement of up to two orders of magnitude for bandwidth and six orders for latency.application/pdfengvirtualizaçãoP4MicroeletrônicaArquiteturas reconfiguraveisRedes virtuais : Comunicacao : DadosProgrammable forwarding planesNetFPGA SUMEProgrammable virtual switches : design and implementation of the forwarding engine and supporting featuresinfo:eu-repo/semantics/publishedVersioninfo:eu-repo/semantics/masterThesisUniversidade Federal do Rio Grande do SulInstituto de InformáticaPrograma de Pós-Graduação em MicroeletrônicaPorto Alegre, BR-RS2020mestradoinfo:eu-repo/semantics/openAccessreponame:Biblioteca Digital de Teses e Dissertações da UFRGSinstname:Universidade Federal do Rio Grande do Sul (UFRGS)instacron:UFRGSTEXT001115567.pdf.txt001115567.pdf.txtExtracted Texttext/plain151683http://www.lume.ufrgs.br/bitstream/10183/211315/2/001115567.pdf.txt08110c1b1609196bcc953e5323eaef78MD52ORIGINAL001115567.pdfTexto completo (inglês)application/pdf2289963http://www.lume.ufrgs.br/bitstream/10183/211315/1/001115567.pdf1fa615fb11cc0a70fcf7034a156297f1MD5110183/2113152024-06-19 06:43:47.487613oai:www.lume.ufrgs.br:10183/211315Biblioteca Digital de Teses e Dissertaçõeshttps://lume.ufrgs.br/handle/10183/2PUBhttps://lume.ufrgs.br/oai/requestlume@ufrgs.br||lume@ufrgs.bropendoar:18532024-06-19T09:43:47Biblioteca Digital de Teses e Dissertações da UFRGS - Universidade Federal do Rio Grande do Sul (UFRGS)false |
dc.title.pt_BR.fl_str_mv |
Programmable virtual switches : design and implementation of the forwarding engine and supporting features |
title |
Programmable virtual switches : design and implementation of the forwarding engine and supporting features |
spellingShingle |
Programmable virtual switches : design and implementation of the forwarding engine and supporting features Tirone, Mateus Saquetti Pereira de Carvalho virtualização P4 Microeletrônica Arquiteturas reconfiguraveis Redes virtuais : Comunicacao : Dados Programmable forwarding planes NetFPGA SUME |
title_short |
Programmable virtual switches : design and implementation of the forwarding engine and supporting features |
title_full |
Programmable virtual switches : design and implementation of the forwarding engine and supporting features |
title_fullStr |
Programmable virtual switches : design and implementation of the forwarding engine and supporting features |
title_full_unstemmed |
Programmable virtual switches : design and implementation of the forwarding engine and supporting features |
title_sort |
Programmable virtual switches : design and implementation of the forwarding engine and supporting features |
author |
Tirone, Mateus Saquetti Pereira de Carvalho |
author_facet |
Tirone, Mateus Saquetti Pereira de Carvalho |
author_role |
author |
dc.contributor.author.fl_str_mv |
Tirone, Mateus Saquetti Pereira de Carvalho |
dc.contributor.advisor1.fl_str_mv |
Azambuja, José Rodrigo Furlanetto de |
dc.contributor.advisor-co1.fl_str_mv |
Cordeiro, Weverton Luis da Costa |
contributor_str_mv |
Azambuja, José Rodrigo Furlanetto de Cordeiro, Weverton Luis da Costa |
dc.subject.por.fl_str_mv |
virtualização P4 Microeletrônica Arquiteturas reconfiguraveis Redes virtuais : Comunicacao : Dados |
topic |
virtualização P4 Microeletrônica Arquiteturas reconfiguraveis Redes virtuais : Comunicacao : Dados Programmable forwarding planes NetFPGA SUME |
dc.subject.eng.fl_str_mv |
Programmable forwarding planes NetFPGA SUME |
description |
A virtualização se tornou a potência de vários conceitos de rede, de redes locais virtuais (VLANs) a switches definidos por software, plano de controle definido por software, etc. Propostas recentes como HyPer4, HyperVDP e P4Visor levaram o conceito ao plano de encaminhamento, permitindo emulação de vários contextos de rede e/ou compondo várias funções através de um único programa. Apesar do progresso alcançado, o verdadeiro potencial da virtualização do plano de encaminhamento permanece inexplorado. Neste trabalho, apresentamos PvS, uma arquitetura reconfigurável para virtualização do plano de dados. PvS fornece execução paralela e hot swap de instâncias de switches virtuais, sem a necessidade de código-fonte do switch (para emulação ou composição de programa). Experimentou-se PvS em uma placa NetFPGA-SUME com quatro switches virtuais: um switch de camada 2, um roteador simples, um firewall e um switch de telemetria de rede(in-band telemetry). As medições de ocupação da área evidenciam a viabilidade de executar até treze switches virtuais em paralelo. Comparado aos trabalhos existentes, os dados de desempenho mostram uma melhoria de até duas ordens de magnitude para largura de banda e seis ordens para latência. |
publishDate |
2020 |
dc.date.accessioned.fl_str_mv |
2020-07-02T03:36:59Z |
dc.date.issued.fl_str_mv |
2020 |
dc.type.status.fl_str_mv |
info:eu-repo/semantics/publishedVersion |
dc.type.driver.fl_str_mv |
info:eu-repo/semantics/masterThesis |
format |
masterThesis |
status_str |
publishedVersion |
dc.identifier.uri.fl_str_mv |
http://hdl.handle.net/10183/211315 |
dc.identifier.nrb.pt_BR.fl_str_mv |
001115567 |
url |
http://hdl.handle.net/10183/211315 |
identifier_str_mv |
001115567 |
dc.language.iso.fl_str_mv |
eng |
language |
eng |
dc.rights.driver.fl_str_mv |
info:eu-repo/semantics/openAccess |
eu_rights_str_mv |
openAccess |
dc.format.none.fl_str_mv |
application/pdf |
dc.source.none.fl_str_mv |
reponame:Biblioteca Digital de Teses e Dissertações da UFRGS instname:Universidade Federal do Rio Grande do Sul (UFRGS) instacron:UFRGS |
instname_str |
Universidade Federal do Rio Grande do Sul (UFRGS) |
instacron_str |
UFRGS |
institution |
UFRGS |
reponame_str |
Biblioteca Digital de Teses e Dissertações da UFRGS |
collection |
Biblioteca Digital de Teses e Dissertações da UFRGS |
bitstream.url.fl_str_mv |
http://www.lume.ufrgs.br/bitstream/10183/211315/2/001115567.pdf.txt http://www.lume.ufrgs.br/bitstream/10183/211315/1/001115567.pdf |
bitstream.checksum.fl_str_mv |
08110c1b1609196bcc953e5323eaef78 1fa615fb11cc0a70fcf7034a156297f1 |
bitstream.checksumAlgorithm.fl_str_mv |
MD5 MD5 |
repository.name.fl_str_mv |
Biblioteca Digital de Teses e Dissertações da UFRGS - Universidade Federal do Rio Grande do Sul (UFRGS) |
repository.mail.fl_str_mv |
lume@ufrgs.br||lume@ufrgs.br |
_version_ |
1810085524911685632 |