Aceleração de Algoritmos de High-Frequency Trading com FPGA

Detalhes bibliográficos
Autor(a) principal: Yamashiro, Eiki Luis
Data de Publicação: 2022
Tipo de documento: Relatório
Idioma: por
Título da fonte: Biblioteca Digital de Teses e Dissertações do INSPER
Texto Completo: https://repositorio.insper.edu.br/handle/11224/5411
Resumo: A bolsa de valores oferece diversos benefícios para investidores, com a renda proveniente de um certo nível de risco, de forma a promover o aquecimento de toda cadeia produtiva e econômica dos países. O High-Frequency Trading ou operações em alta frequência permite a análise de uma grande quantidade de informação, à uma alta cadência de transferência de dados. Entre o tempo da requisição até a recepção da ordem, o preço pode variar, ou seja, o valor esperado, pode ser diferente do valor real. Mediante a essa situação, um método para acelerar algoritmos através de FPGAs é proposto, com o objetivo de diminuir o tempo entre a requisição e a recepção. O foco da aceleração está na decodificação do protocolo FIX através da placa FPGA.
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