Implementação de gerador de Testbench UVM.

Detalhes bibliográficos
Autor(a) principal: ARRUDA, Lucas Eliseu Gonçalves de.
Data de Publicação: 2019
Tipo de documento: Trabalho de conclusão de curso
Idioma: por
Título da fonte: Biblioteca Digital de Teses e Dissertações da UFCG
Texto Completo: http://dspace.sti.ufcg.edu.br:8080/jspui/handle/riufcg/19059
Resumo: Pertencente a um ambiente com tempo de mercado restrito, a área da microeletrônica é constantemente desafiada para entrega de dispositivos nesses prazos limitados. Esse fato é ainda mais verdadeiro para o setor de verificação, que comumente ocupa 70% do tempo de projeto. Nesse contexto, o gerador de testbench UVM é desenvolvido como ferramenta de automatização para auxílio dos verificadores tanto no início de verificação de IPs quanto para realização de alterações de design.
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In this context, the UVM testbench generator is developed as an automation tool to help engineers on both IP verification kickoff and to account for design modifications.Submitted by Ruth Quaresma de Freitas (ruth_quaresma@hotmail.com) on 2021-05-26T21:14:26Z No. of bitstreams: 1 LUCAS ELISEU GONÇALVES DE ARRUDA - TCC ENG. ELÉTRICA 2019.pdf: 1022654 bytes, checksum: 91501a0d5e2ffb43cf4517ed4c9efde4 (MD5)Made available in DSpace on 2021-05-26T21:14:26Z (GMT). No. of bitstreams: 1 LUCAS ELISEU GONÇALVES DE ARRUDA - TCC ENG. ELÉTRICA 2019.pdf: 1022654 bytes, checksum: 91501a0d5e2ffb43cf4517ed4c9efde4 (MD5) Previous issue date: 2019-11-18Universidade Federal de Campina GrandeUFCGBrasilCentro de Engenharia Elétrica e Informática - CEEIEngenharia Elétrica.Gerador de Testbench UVMMicroeletrônicaPythonUVM - Universal Verification MethodologyUniversal Verification MethodologyUVM Testbench GeneratorMicroelectronicsImplementação de gerador de Testbench UVM.Implementation of UVM Testbench generator.2019-11-182021-05-26T21:14:26Z2021-05-262021-05-26T21:14:26Zhttp://dspace.sti.ufcg.edu.br:8080/jspui/handle/riufcg/19059ARRUDA, Lucas Eliseu Gonçalves de. Implementação de gerador de Testbench UVM. 2019. 52f. (Trabalho de Conclusão de Curso - Monografia), Curso de Bacharelado em Engenharia Elétrica, Centro de Engenharia Elétrica e Informática , Universidade Federal de Campina Grande – Paraíba - Brasil, 2019. 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