Desenvolvimento de hardware para a transformada rotacional 8x8 com foco na codificação de vídeos digitais de altíssima resolução
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Data de Publicação: | 2012 |
Tipo de documento: | Dissertação |
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Texto Completo: | http://guaiaca.ufpel.edu.br/handle/prefix/5661 |
Resumo: | A Transformada Rotacional (ROT) é uma das novas ferramentas propostas para o padrão emergente de codificação de vídeo HEVC. O objetivo desta ferramenta de codificação é obter maior compactação da energia presente na matriz de coeficientes da transformada principal, melhorando a eficiência da codificação de entropia e minimizando o erro de quantização. Arquiteturas de hardware dedicadas à codificação e decodificação de vídeo são essenciais para garantir o desempenho necessário com baixo consumo de energia e potência, fatores especialmente críticos em dispositivos móveis e portáteis. Este trabalho apresenta uma investigação da ROT com foco no desenvolvimento de soluções em hardware para esta transformada. O trabalho detalha a exploração algorítmica realizada para simplificar as equações, visando a implementação em hardware. São apresentadas três versões arquiteturais para as transformadas ROT direta e inversa, gerando diferentes alternativas de desempenho em termos de taxa de processamento e consumo de hardware. As arquiteturas foram descritas em VHDL e sintetizadas para um FPGA da família Stratix III. Os resultados mostram que todas as versões da arquitetura são capazes de processar vídeos até a resolução 4K UHD (3840x2160 pixels) a 30 quadros por segundo. A versão com a maior taxa de processamento obteve uma frequência máxima de operação de 215,01 MHz. Essa versão da arquitetura atinge uma taxa de processamento de 1,72 bilhão de amostras por segundo, permitindo o processamento de vídeos até a resolução 8K UHD (7680x4320 pixels) a uma taxa de 30 quadros por segundo. |
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2020-06-04T01:46:13Z2020-06-04T01:46:13Z2012-11-12VIANNA, Henrique A. Desenvolvimento de Hardware para a Transformada Rotacional 8x8 com Foco na Codificação de Vídeos Digitais de Altíssima Resolução. 2012. 79f. Dissertação (Mestrado em Ciência da Computação). Universidade Federal de Pelotas, Pelotas.http://guaiaca.ufpel.edu.br/handle/prefix/5661A Transformada Rotacional (ROT) é uma das novas ferramentas propostas para o padrão emergente de codificação de vídeo HEVC. O objetivo desta ferramenta de codificação é obter maior compactação da energia presente na matriz de coeficientes da transformada principal, melhorando a eficiência da codificação de entropia e minimizando o erro de quantização. Arquiteturas de hardware dedicadas à codificação e decodificação de vídeo são essenciais para garantir o desempenho necessário com baixo consumo de energia e potência, fatores especialmente críticos em dispositivos móveis e portáteis. Este trabalho apresenta uma investigação da ROT com foco no desenvolvimento de soluções em hardware para esta transformada. O trabalho detalha a exploração algorítmica realizada para simplificar as equações, visando a implementação em hardware. São apresentadas três versões arquiteturais para as transformadas ROT direta e inversa, gerando diferentes alternativas de desempenho em termos de taxa de processamento e consumo de hardware. As arquiteturas foram descritas em VHDL e sintetizadas para um FPGA da família Stratix III. Os resultados mostram que todas as versões da arquitetura são capazes de processar vídeos até a resolução 4K UHD (3840x2160 pixels) a 30 quadros por segundo. A versão com a maior taxa de processamento obteve uma frequência máxima de operação de 215,01 MHz. Essa versão da arquitetura atinge uma taxa de processamento de 1,72 bilhão de amostras por segundo, permitindo o processamento de vídeos até a resolução 8K UHD (7680x4320 pixels) a uma taxa de 30 quadros por segundo.The Rotational Transform (ROT) is one of the novel tools proposed for the HEVC emergent video coding standard. The main goal of this coding tool is to achieve higher energy compaction of the main transform coefficient matrix and thus improve entropy coding and minimize quantization error. Dedicated hardware architectures for video coding and decoding are essential to guarantee the necessary performance with low power and energy consumption, which are especially critical resources on portable and mobile devices. This work presents an investigation of the ROT focusing on the development of hardware solutions for the transform. The work explains in details the algorithmic exploration targeting hardware implementation. Three architectural versions are presented for the forward and inverse ROT transforms, generating different performance alternatives considering processing rate and hardware consumption. The architectures were described in VHDL and synthesized for a Stratix III FPGA. Results show that all versions of the architecture are capable of processing videos up to the resolution 4K UHD (3840x2160 pixels) at 30 frames per second. The version with the highest processing rate achieved a maximum operation frequency of 215.01 MHz. This version of the architecture reaches a processing rate of 1.72 billion samples per second, allowing it to process videos up to the resolution 8K UHD (7680x4320 pixels) at 30 frames per second.porUniversidade Federal de PelotasPrograma de Pós-Graduação em ComputaçãoUFPelBrasilCentro de Desenvolvimento TecnológicoCNPQ::CIENCIAS EXATAS E DA TERRA::CIENCIA DA COMPUTACAOComputaçãoCodificação de vídeoHEVCTransformada rotacionalSistemas digitaisProjeto em FPGAVideo codingRotational transformDigital systemsFPGA based designDesenvolvimento de hardware para a transformada rotacional 8x8 com foco na codificação de vídeos digitais de altíssima resoluçãoinfo:eu-repo/semantics/publishedVersioninfo:eu-repo/semantics/masterThesishttp://lattes.cnpq.br/5190916021950132http://lattes.cnpq.br/9604735363839730Agostini, Luciano VolcanVianna, Henrique Avilainfo:eu-repo/semantics/openAccessreponame:Repositório Institucional da UFPel - Guaiacainstname:Universidade Federal de Pelotas (UFPEL)instacron:UFPELTEXTDissertacao_Henrique_Avila_Vianna.pdf.txtDissertacao_Henrique_Avila_Vianna.pdf.txtExtracted texttext/plain144552http://guaiaca.ufpel.edu.br/xmlui/bitstream/prefix/5661/6/Dissertacao_Henrique_Avila_Vianna.pdf.txtc5f08578ee1a65dca9dfeafac248df76MD56open accessTHUMBNAILDissertacao_Henrique_Avila_Vianna.pdf.jpgDissertacao_Henrique_Avila_Vianna.pdf.jpgGenerated Thumbnailimage/jpeg1607http://guaiaca.ufpel.edu.br/xmlui/bitstream/prefix/5661/7/Dissertacao_Henrique_Avila_Vianna.pdf.jpg908c4201f118e12de90432c7c4ba7f40MD57open accessORIGINALDissertacao_Henrique_Avila_Vianna.pdfDissertacao_Henrique_Avila_Vianna.pdfapplication/pdf1579455http://guaiaca.ufpel.edu.br/xmlui/bitstream/prefix/5661/1/Dissertacao_Henrique_Avila_Vianna.pdfa126c83b12aa2c7fbf56b62308d0fa8eMD51open accessCC-LICENSElicense_urllicense_urltext/plain; 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